Verification methodology manual for systemverilog :: SCD d'Orléans

Verification methodology manual for systemverilog

Verification methodology manual for systemverilog

Functional verification remains one of the single biggest challenges in the development of complex system-on-chip (SoC) devices. Despite the introduction of successive new technologies, the gap between design capability and verification confidence continues to widen. The biggest problem is that thes...

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Bibliografiske detaljer
Auteurs principaux:	Bergeron, Janick, Cerny, Eduard (Auteur), Hunter, Alan (Auteur), Nightingale, Andy (Auteur)
Format:	Livre numérique
Sprog:	Anglais
Udgivet:	New York, NY : Springer US 2006. Cham : Springer Nature
Fag:	Circuits intégrés Verilog (langage de description de matériel informatique)
Online adgang:	Accès sur la plateforme de l'éditeur Accès sur la plateforme Istex Accès Université d'Orléans Accès INSA CVL
Kommentar:	Archives Springer e-books (Licence nationale) Archives Springer e-books (Licence nationale)
Autres localisations:	Voir dans le Sudoc
Edition sous un autre format:	• Verification Methodology Manual for SystemVerilog, Texte imprimé, 9780387255385 • Verification Methodology Manual for SystemVerilog, Texte imprimé, 9780387506456 • Verification Methodology Manual for SystemVerilog, Texte imprimé, 9781461498131

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