Functional verification of programmable embedded architectures : A top-down approach
Validation of programmable architectures, consisting of processor cores, coprocessors, and memory subsystems, is one of the major bottlenecks in current System-on-Chip design methodology. A critical challenge in validation of such systems is the lack of a golden reference model. As a result, many ex...
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| Auteurs principaux: | , |
|---|---|
| 格式: | Livre numérique |
| 語言: | Anglais |
| 出版: |
New York, NY :
Springer US
2005.
Cham : Springer Nature |
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