Error Control for Network-on-Chip Links
As technology scales into nanoscale regime, it is impossible to guarantee the perfect hardware design. Moreover, if the requirement of 100% correctness in hardware can be relaxed, the cost of manufacturing, verification, and testing will be significantly reduced. Many approaches have been proposed t...
Shranjeno v:
| Auteurs principaux: | , |
|---|---|
| Format: | Livre numérique |
| Jezik: | Anglais |
| Izdano: |
New York, NY :
Springer New York
2012.
Cham : Springer Nature |
| Online dostop: | Accès sur la plateforme de l'éditeur Accès sur la plateforme Istex Accès Université d'Orléans Accès INSA CVL |
| Sporočilo: |
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| Edition sous un autre format: | • Error Control for Network-on-Chip Links, Texte imprimé, 9781441993120 • Error Control for Network-on-Chip Links, Texte imprimé, 9781441993144 • Error Control for Network-on-Chip Links, Texte imprimé, 9781489986337 |