VHDL : langage, modélisation, synthèse
محفوظ في:
| المؤلفون الرئيسيون: | , , , |
|---|---|
| التنسيق: | Livre papier |
| اللغة: | Français |
| منشور في: |
Lausanne :
Presses polytechniques et universitaires romandes
C 1998.
25-Thise : impr. Jacques et Demontrond |
| الطبعة: | 2e édition revue et augmentée. |
| سلاسل: | Collection technique et scientifique des télécommunications
Collection Informatique |
| الموضوعات: | |
| ملاحظة: |
Autres tirages : 2003, 2004 Collection Informatique sur la jaquette, Collection technique et scientifique des télécommunications sur la couverture Autre contribution : Jacques Rouillard |
| Autres localisations: | Voir dans le Sudoc |
| Edition sous un autre format: | • VHDL, Ressource électronique, langage, modélisation, synthèse, Roland Airiau,... Jean-Michel Bergé,... Vincent Olive,... [et al.]., Bagneux, PPUR, 2007 |
| LEADER | 03298nam a22004217a 4500 | ||
|---|---|---|---|
| 001 | 256954 | ||
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| 082 | |a 003.3 | ||
| 100 | 1 | |a Airiau, Roland. | |
| 245 | 1 | 0 | |a VHDL : |b langage, modélisation, synthèse |c Roland Airiau, Jean-Michel Bergé, Vincent Olive,... [et autres]. |
| 250 | |a 2e édition revue et augmentée. | ||
| 260 | |a Lausanne : |b Presses polytechniques et universitaires romandes. | ||
| 260 | |c C 1998. | ||
| 260 | |a 25-Thise : |b impr. Jacques et Demontrond. | ||
| 300 | |a 1 volume (xv-568 pages) : |b illustrations, couverture illustrée ; |c 24 cm. | ||
| 490 | 1 | |a Collection technique et scientifique des télécommunications |x 0221-2579 | |
| 490 | 0 | |a Collection Informatique | |
| 500 | |a Autres tirages : 2003, 2004 | ||
| 500 | |a Collection Informatique sur la jaquette, Collection technique et scientifique des télécommunications sur la couverture | ||
| 500 | |a Autre contribution : Jacques Rouillard | ||
| 504 | |a Bibliographie p. [557]-563. Glossaire. Index | ||
| 505 | 0 | |a Premère partie : le langage (parler VHDL) -- Introduction -- Tour du propriétaire -- Premiers éléments du langage -- Unités de conception -- Sous-programmes -- Types de données -- Déclarations et spécifications -- Instructions séquentielles -- Instructions concurrentes -- Généricité -- Attributs -- Paquetages STANDARD -- Compilation, élaboration, exécution, exploitation -- Variables partagées et autres regrets -- Pièges -- Deuxième partie : la modélisation (écrire en VHDL) -- Qu'est-ce que modéliser? -- Registre et additionneur -- Circuits linéaires -- Automate d'états finis : contrôleur de trafic -- Vérification de temps de set-up, de hold -- Piles LIFO et FIFO -- Unité arithmétique et logique -- Mémoire vive : RAM -- Mémoire morte : ROM -- Réseaux de communication -- Réseau neuronique -- Contrôle moteur -- Carte microcalculateur -- Générateur de séquence de stimuli -- Sortie de courbes -- Paquetage sur type bit étendu : IEEE.STD_LOGIC_1164 -- Troisième partie : la grammaire (lire VHDL) -- Qu'est-ce que la synthèse ? -- Styles de description -- Circuits combinatoires -- Circuits synchrones -- Paquetages arithmétiques -- Quatrième partie : les annexes (en savoir plus sur VHDL) -- Glossaire -- Groupes de normalisation -- Bibliographie et adresses utiles -- Index | |
| 650 | |a VHDL (langage de description de matériel informatique) | ||
| 650 | |a Circuits intégrés numériques |x Conception technique | ||
| 650 | |a Circuits électroniques | ||
| 650 | |a Circuits intégrés | ||
| 650 | |a Modèles mathématiques | ||
| 700 | 1 | |a Bergé, Jean-Michel. |4 aut | |
| 700 | 1 | |a Olive, Vincent, |d 1956-...., |c auteur en informatique. |4 aut | |
| 700 | 1 | |a Rouillard, Jacques, |d 19..-...., |c ingénieur. |4 aut | |
| 710 | 2 | |a Presses polytechniques et universitaires romandes. |4 pbl | |
| 776 | 0 | |0 112326781 |t VHDL |b Ressource électronique |o langage, modélisation, synthèse |f Roland Airiau,... Jean-Michel Bergé,... Vincent Olive,... [et al.]. |c Bagneux |n PPUR |d 2007 | |
| 997 | |0 256954 |1 Livre papier |a Ressource papier |c 0/Chartres/ |c 1/Chartres/IUT Chartres/ |z Chartres, IUT Chartres, 621.385 VHD | ||